1. নন্দ কম দেরি করে।
আপনি বলছিল হিসাবে, বিলম্বের জন্য সমীকরণ হয়
কিন্তু যৌক্তিক প্রচেষ্টা NAND নর যে এর চেয়ে কম হয় জন্য। 2 ইনপুট সিএমওএস ন্যান্ড এবং এনওআর গেট দেখানো চিত্রটি বিবেচনা করুন। প্রতিটি ট্রানজিস্টরের বিপরীতে সংখ্যাটি আকারের একটি পরিমাপ এবং তাই ক্যাপাসিট্যান্স।
Delay=t(gh+p)
g
যৌক্তিক প্রয়াসকে as হিসাবে হিসাবে গণনা করা যায় । যা দেয়g=Cin/3
- g=4/3 2 ইনপুট NAND এর জন্য এবং এন ইনপুট ন্যান্ড গেটের জন্যg=n+23
- g=5/3 2 ইনপুট NOR এর জন্য এবং n ইনপুট NOR গেটের জন্যg=2n+13
- টেবিলের জন্য উইকি উল্লেখ করুন ।
h=1 একটি গেটের জন্য (NAND বা NOR) একই গেটটি চালাচ্ছে এবং NAND এবং NOR উভয়ের জন্য । সুতরাং এনওআর এর সাথে তুলনা করার সময় ন্যানডের কম বিলম্ব হয়।p=2
সম্পাদনা: আমার আরও দুটি পয়েন্ট রয়েছে তবে আমি শেষ পয়েন্টটি সম্পর্কে 100% নিশ্চিত নই।
২. এনওআর আরও বেশি জায়গা দখল করে।
আকারে ট্রানজিস্টরের আকার যুক্ত করে, এটি স্পষ্ট যে এনওআর এর আকার ন্যানডের চেয়ে বেশি। ইনপুট সংখ্যা বৃদ্ধি পাওয়ায় আকারে এই পার্থক্য বাড়বে।
এনওআর গেটটি নন্দ গেটের চেয়ে বেশি সিলিকন এলাকা দখল করবে।
৩. নান্ড একই মাপের ট্রানজিস্টর ব্যবহার করে।
চিত্রটি আবার বিবেচনা করে, ন্যানড গেটের সমস্ত ট্রানজিস্টরের সমান আকার রয়েছে যেখানে এনওআর গেটগুলি নেই। যা ন্যানড গেটের উত্পাদন ব্যয় হ্রাস করে। আরও ইনপুট সহ গেটগুলি বিবেচনা করার সময়, এনওআর গেটগুলির জন্য 2 টি বিভিন্ন মাপের ট্রানজিস্টর প্রয়োজন যাদের ন্যানড গেটগুলির সাথে তুলনা করার সময় আকারের পার্থক্য বেশি।